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    发布日期: 2021-06-01
  • 语言: 其他
  • 标签: verilog  

资源简介

用cpld实现m序列的fsk调制,调制信号的1码对应于频率为f1的正弦波,0码对应于频率为f2的正弦波,最后将两种频率的正弦波拼接后输出。

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