基于ram的简易串口数据收发系统

基于ram的简易串口数据收发系统，采用verilog语言编写

 属性            大小     日期    时间   名称
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     文件      32048  2015-10-14 20:50  class13_dpram\doc\UART_DPRAM.vsdx

    ..A..H.       162  2015-10-13 19:51  class13_dpram\doc\~$式块RAM应用之双口ram.docx

     文件     868074  2015-10-14 20:51  class13_dpram\doc\嵌入式块RAM应用之双口ram.docx

     文件       1280  2015-09-29 21:31  class13_dpram\prj\dpram.qpf

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     文件        516  2015-10-14 22:12  class13_dpram\prj\output_files\greybox_tmp\cbx_args.txt

     文件       1307  2015-10-14 21:46  class13_dpram\rtl\CTRL.v

     文件       2562  2015-09-20 20:52  class13_dpram\rtl\key_filter.v

     文件       4876  2015-09-29 20:29  class13_dpram\rtl\uart_byte_rx.v

     文件       2511  2015-09-29 20:56  class13_dpram\rtl\uart_byte_tx.v

     文件       1225  2015-10-14 21:27  class13_dpram\rtl\UART_DPRAM.v

     文件        763  2015-09-29 21:57  class13_dpram\testbench\dpram_tb.v

     文件        517  2015-08-29 21:44  class13_dpram\testbench\key_model.v

     文件       1524  2015-10-14 22:03  class13_dpram\testbench\UART_DPRAM_tb.v

............此处省略14个文件信息