基于FPGA的数字电子时钟设计

使用verilog语言进行编写程序，综合实现数字电子时钟的功能

 属性            大小     日期    时间   名称
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     文件        1970  2018-06-28 20:36  clock_seg\prj\db\clock_seg.（4）.cnf.cdb
............此处省略121个文件信息