三人抢答器，Verilog实现.zip

以Verilog HDL硬件描述语言作为平台，结合动手实验而完成的。它的特点是电路简单、制作方便、操作简单、方便、性能可靠，实用于多种智力竞赛活动。artus II工具软件完成了Verilog HDL源程序编写和硬件下载。这个抢答器设计基本上满足了实际比赛应用中的各种需要。在实际中有很大的用途。

 属性            大小     日期    时间   名称
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     文件        1590  2019-07-03 23:15  QD\COM.v.bak
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     文件        1991  2019-07-02 16:52  QD\db\QD.（7）.cnf.cdb
     文件        1289  2019-07-02 16:52  QD\db\QD.（7）.cnf.hdb
     文件        2162  2019-07-03 23:25  QD\db\QD.asm.qmsg
     文件       36679  2019-07-03 23:25  QD\db\QD.asm_labs.ddb
     文件          84  2019-07-03 23:25  QD\db\QD.cbx.xml
     文件         954  2019-07-03 23:25  QD\db\QD.cmp.bpm
     文件       97003  2019-07-03 23:25  QD\db\QD.cmp.cdb
............此处省略97个文件信息