FPGA课程设计-硬件乐曲演奏Verilog HDL

题目要求：自动播放设计好的乐曲；至少能播放两个以上的乐曲；含代码文件和测试结果，仅供参考

 属性            大小     日期    时间   名称
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     文件     1031374  2017-08-20 21:10  FPGA课程设计报告.pdf
     目录           0  2017-08-20 21:06  Music\
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     文件        1943  2017-03-01 09:16  Music\cnt_79.bsf
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     目录           0  2017-08-20 21:06  Music\db\
     文件        4062  2017-02-28 13:01  Music\db\add_sub_5nh.tdf
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     文件         245  2017-03-12 12:11  Music\db\music.ipinfo
     文件         232  2017-03-11 17:36  Music\db\music.pplq.rdb
     文件        1784  2017-03-02 10:50  Music\db\music.sim.cvwf
     文件         202  2017-03-12 12:11  Music\db\music.sld_design_entry.sci
     文件        2393  2017-02-28 13:03  Music\db\mux_1ac.tdf
     文件        1745  2017-03-02 08:49  Music\db\mux_s9c.tdf
............此处省略44个文件信息