Verilog ADV7123的PAL D控制信号

主要是实现控制ADV7123的信号，是实现PAL D的电视信号的SYNC，BLANK等信号的产生。只上传了代码，未上传工程，太大了。请自建工程。

 属性            大小     日期    时间   名称
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     文件        9425  2015-06-21 19:21  PalSyncBlankGen.v