资源简介
用Verilog语言描述可变占空比分频器，输入频率自行定义。
通过控制信号Div（2位）选择，Div=00：原频率输出；Div=01：2分频输出；Div=10：3分频输出；Div=11：5分频输出；
使用PMW（2位）信号控制占空比，PMW=00：占空比1：1；PMW=01：占空比1：2；PMW=10：占空比2：1；PMW=11：占空比3：2。
代码片段和文件信息
相关资源
- 《计算机原理与设计:Verilog HDL版》-李
- 华为 Verilog_HDL_三套教程
- Verilog 编写基于SRAM 的代码
-
Altera公司的Verilog Coding st
yle - Notepad++下Verilog自动完成的配置文件
- Verilog夏宇闻 数字系统设计课后题答案
- Verilog8b10b编码
- Master SPI的Verilog源代码（包括文档 测
- Verilog ADV7123的PAL D控制信号
- 基于FPGA cyclone II 的LCD显示verilog代码
- 占空比，幅值和步进可调的DDS输出，
- 32位进位选择加法器
- [traffic]设计并实现一十字路口的红、
- FPGA直接驱动LCD12864的Verilog程序
- Verilog HDL 矩阵键盘扫描
- verilog一维DCT算法程序
- 北航计组代码四p5--Verilog流水线
- 北航计组实验代码五p6--Verilog流水线
- spi flash verilog simulation model仿真模型
- 高速缓存（Cache）的Verilog代码
- ad7705verilog程序
- 华为FPGA设计规范Verilog_HDL
- 用Verilog写的等效采样程序
- verilog-XL操作手册
- verilog 交通灯
- 基于FPGA的Verilog HDL语言数字钟
- fpga flash control verilog
- Verilog 数字钟与汽车尾灯
- CAN驱动器-MCP2515-接口程序-Verilog
- Verilog语言编写的VGA显示-俄罗斯方块
评论
共有 条评论