verilog hdl语言简易十进制计算器

使用Verilog HDL语言开发的简易十进制计算器。输入为4*4矩阵键盘，输出为数码管，可进行一位十进制加减乘除运算。FPGA芯片为Cyclone II EP2C8C208。使用时管脚分配应根据实际硬件情况重新编订。

 属性            大小     日期    时间   名称
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     文件        628  2013-06-14 10:10  Calculator\key_2\db\key_2.（5）.cnf.hdb

     文件       1002  2013-06-14 10:10  Calculator\key_2\db\key_2.（6）.cnf.cdb

     文件        655  2013-06-14 10:10  Calculator\key_2\db\key_2.（6）.cnf.hdb

............此处省略107个文件信息