卷积码_讯易软件-源码之巅峰

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卷积码的viterbi维特比译码算法的FPG 0

编程语言：其他大小：金币：上传人：haoyisheng 发布日期：2023-11-21

2,1,7卷积码的viterbi译码算法的FPGA实现,内容详细,而且附带源代码
卷积码（2_1_3）编译码课程设计 0

编程语言：其他大小：金币：上传人：haoyisheng 发布日期：2023-10-27

卷积码(2_1_3)编译器的设计，卷积码原理、发展，卷积码编码过程和维特比译码。
217卷积码的viterbi译码算法的FPGA实现内 0

编程语言：其他大小：金币：上传人：ligangyuer 发布日期：2023-10-26

2,1,7卷积码的viterbi译码算法的FPGA实现,内容详细,而且附带源代码.rar
卷积码的译码的两种算法 0

编程语言：其他大小：金币：上传人：chaoshanxx 发布日期：2023-10-23

卷积编码器自身具有网格结构，基于此结构我们给出两种译码算法：Viterbi译码算法和BCJR 译码算法。基于某种准则，这两种算法都是最优的。
RS255239和217卷积码的级联实现代码 0

编程语言：其他大小：金币：上传人：chaoshanxx 发布日期：2023-10-16

RS（255,239）和（2,1,7）卷积码的级联实现代码，在quartus ii 9.0上仿真实现了的。
编码理论周武旸中国科学技术大学 0

编程语言：其他大小：金币：上传人：pppxxx 发布日期：2023-09-29

编码理论讲的很详细，大多翻译外国经典教材
卷积码软硬判决误码率曲线及其代码 0

编程语言：其他大小：金币：上传人：pppxxx 发布日期：2022-06-11

卷积码软判决硬判决误码率的分析及其程序代码
基于System View的卷积码码编译码系统 1

编程语言：其他大小：金币：上传人：wjd2002xx 发布日期：2021-09-04

本课程设计主要基于System View平台，实现卷积码编译码系统的设计与仿真，添加高斯噪声测试系统抗噪声性能，通过理论结果与仿真结果分析，调整系统参数设置，寻找系统的最大抗噪声
卷积码发生器的设计 1

编程语言：Matlab 大小：金币：上传人：yuyunfu 发布日期：2021-07-23

本课程设计主要解决对一个卷积码序列进行维特比(Viterbi)译码输出,并通过Matlab软件进行设计与仿真，并进行误码率分析。根据线性幅度调制原理，设计一个AM调制系统，实现模拟混合加
卷积码及维特比译码matlab程序 0

编程语言：Matlab 大小：金币：上传人：ligangyuer 发布日期：2021-06-19

卷积码是一种性能优越的信道编码，它的编码器和解码器都比较易于实现，同时还具有较强的纠错能力，这使得它的使用越来越广泛。
bsc信道的2/3卷积码matlab仿真 0

编程语言：Matlab 大小：金币：上传人：shangyou88 发布日期：2021-06-14

matlab下使用bsc信道仿真2/3码率的卷积码的误码率的代码。
维特比译码verilog程序 0

编程语言：其他大小：金币：上传人：shangyou88 发布日期：2021-06-13

（2,1,3）卷积码的维特比译码程序，verilog语言编写，模块可以直接使用
未编码，汉明码，循环码及卷积码性 0

编程语言：Matlab 大小：金币：上传人：shangyou88 发布日期：2021-06-09

基于MATLAB通过对未编码，汉明码，循环码及卷积码的信噪比进行比较，比较它们之间的性能
2，1，7卷积码 0

编程语言：其他大小：金币：上传人：kbls57736 发布日期：2021-06-08

其中包括卷积码的编码器与译码器的设计方案，对学习卷积友有帮助。
卷积码的基本结构和基本原理 0

编程语言：其他大小：金币：上传人：kbls57736 发布日期：2021-06-06

在一个二进制分组码（n,k）当中，包含k个信息位，码组长度为n，每个码组的（n-k）个校验位仅与本码组的k个信息位有关，而与其它码组无关。为了达到一定的纠错能力和编码效率（＝
卷积码的程序和论文，有程序和误码 0

编程语言：其他大小：金币：上传人：wjd2002xx 发布日期：2021-06-04

有程序和误码率的图，可以得出误码率曲线有详细的注释都是M文件

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