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    文件类型: .7z
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    发布日期: 2023-10-20
  • 语言: 其他
  • 标签: FPGA  IIR  Vivado  Verilog  

资源简介

使用Vivado完成直接型结构IIR滤波器Verilog HDL设计,含testbench与仿真,仿真结果优秀;具体说明可参考本人博客。CSDN博客搜索:FPGADesigner

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